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Logischer Entwurf hasardtoleranter asynchroner Schaltwerksverbünde
Fortschritt-Berichte VDI : Reihe 20, Rechnerunterstützte Verfahren : 324 (Alle Bände)
Als Ms. gedr, 2000
Signatur: XVW15687

Details

Autor(en) / Beteiligte
Titel
Logischer Entwurf hasardtoleranter asynchroner Schaltwerksverbünde
Ist Teil von
Auflage
Als Ms. gedr
Ort / Verlag
Düsseldorf : VDI-Verl.
Erscheinungsjahr
2000
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Sprache
Deutsch
Identifikatoren
ISBN: 3183324202
OCLC-Nummer: 1068766848, 1068766848
Titel-ID: 990008248060106463
Format
VII, 237 S. : graph. Darst.
Systemstelle
YCH, XVW
Schlagworte
Asynchrones Schaltwerk, Hasard, Logiksynthese

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